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大規(guī)模集成電路
設(shè)計與驗證
支持SoC芯片規(guī)劃與驗證、時序驗證和標(biāo)準(zhǔn)單元庫特征化與驗證，提前預(yù)測并預(yù)防設(shè)計問題，同時可協(xié)助客戶高效創(chuàng)建標(biāo)準(zhǔn)單元庫。
電路仿真
數(shù)字電路仿真是利用計算機(jī)仿真數(shù)字電路的工作過程，以驗證設(shè)計的正確性和性能。通過軟件仿真電路在不同數(shù)字輸入條件下的輸出行為，可檢查邏輯功能、時序關(guān)系和數(shù)字電氣特性等。數(shù)字電路仿真有助于提前發(fā)現(xiàn)和解決設(shè)計中的問題，減少實際制造和調(diào)試的成本與時間，對芯片設(shè)計和產(chǎn)品的質(zhì)量及生產(chǎn)效率具有直接且關(guān)鍵性的影響。
概倫先進(jìn)數(shù)字仿真器VeriSim配備高性能的仿真引擎和約束求解器，全面覆蓋系統(tǒng)級、行為級、RTL級和門級數(shù)字電路仿真驗證的需求，提供全面的數(shù)字設(shè)計驗證解決方案。
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標(biāo)準(zhǔn)單元庫
標(biāo)準(zhǔn)單元庫 (Standard Cell Library) 是集成電路設(shè)計中的重要的標(biāo)準(zhǔn)化電路單元庫，其中包含多種邏輯門電路，用于實現(xiàn)復(fù)雜的數(shù)字電路設(shè)計。標(biāo)準(zhǔn)單元庫通常由芯片制造廠提供，可以優(yōu)化電路面積、功耗和性能，提高芯片可靠性。
概倫標(biāo)準(zhǔn)單元庫解決方案采用先進(jìn)的分布式并行架構(gòu)技術(shù)和單元電路分析提取算法，內(nèi)嵌高精度SPICE仿真器，以快捷、高精的標(biāo)準(zhǔn)單元庫特征化平臺NanoCell為代表，覆蓋從標(biāo)準(zhǔn)單元庫自動化設(shè)計、庫特征化到驗證的完整設(shè)計開發(fā)流程。
SoC設(shè)計與驗證
SoC設(shè)計與驗證涵蓋系統(tǒng)級芯片的全面開發(fā)過程，從架構(gòu)設(shè)計、IP選擇、集成到功能驗證和性能驗證，全程使用硬件描述語言（如Verilog或VHDL），并借助仿真、驗證工具確保設(shè)計的正確性和性能。在IC制造中，SoC設(shè)計與驗證起著至關(guān)重要的作用。通過提前發(fā)現(xiàn)和解決設(shè)計中的問題，減少實際制造和調(diào)試的成本與時間。
概倫提供以門級晶體管級混合時序分析工具TRASTA為代表的一系列SoC電路設(shè)計與驗證解決方案，可靈活適應(yīng)不同設(shè)計需求和場景，提高芯片設(shè)計可靠性、加快產(chǎn)品上市時間、降低成本和風(fēng)險，助力客戶高效完成設(shè)計目標(biāo)。
